MPEG声音编码的单片DSP实现

4　硬件设计

硬件结构框图如图3所示.各模块的基本功能如下：

　　
DSP核：除完成所有编码算法以外，还要完成对模数转换电路的初始化深圳电感配置；通过辅助控制电路选择抽样时钟，通过接口电路接受主机的编码参数.

辅助控制电路：由FPGA及附属电路实现，完成时钟的产生、FIFO状态的监测、地址译码等功能.

输出缓冲：编码码流的暂时存储区，同时提供完全异步的输出接口方式.在需要实现图象声音唇形同步的应用中特别有用.

外部存储器一体电感：包括BDMA空间、I/O空间.

模数转换电路：完成声音的数字化，直接与D差模电感SP的串口0连接.抽样频率由外部提供的256倍抽样时钟的频率决定，正常工作前需要进行初共模电感始化.

接口电路：接口电路分为两部分，一部分是编码输出接口，另一部分是与主机连接的接口.主机接口使用RS232接口芯片完成DSP串口1与主机串口绕行电感的连接，DSP使用中断和内部计时器实现异步串型通信.

上述方案已经在“九五”科技攻关项目中实现，实时编解码的声音通过了主观测试.

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