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* 非法的符号和/或引脚属性。例如，引脚类型可具有IN值，但不包括INPUT值。这将对后端封装工具(如pcbfwd)如何为布线工具(如Allegro)提供信息产生影响。
* 符号上的参考标志符值，尤其是对于串行器件(如电阻、电容和电感)。大多数信号完整性工具需要这些器件以字母R、C和L开头，因此可将这些器件作为串联元件而非离散器件进行分析。类似地，drc_inst()函数可将其值同描述的属性进行对比以保证两者完全匹配。
* 非法去耦电容。这可能导致POWER线dv/dt问题。* 非法上拉和下拉电阻。
* 不与符号POWER或GROUND平面相连的POWER或GROUND引脚。
* 未使用的输入引脚不被电阻上拉或下拉，或者该电阻不与POWER或GROUND网路直接相连。
* 当单个电阻器上拉或下拉1个以上输入引脚时发出警告信息。
* 对于直接与POWER或GROUND网路相连的非专用POWER和GROUND引脚发出警告信息。
如果采用了标记技术，那么将检验该标记是否注明了正确的可选器件，例如型号是否有效及其几何结构是否与默认的器件规格匹配。
DRC不应当具备的功能
尽管DRC能够实现很多功能，但仍然可以采用其它方法以期更好更便捷地加以实现。后端封装工具可为布线工具封装PCB设计，因此可提供有效帮助。在ViewDraw中，pcbfwd可用来检测诸多违反规则的设计缺陷和设计错误。
DRC和pcbfwd可检测的问题之间存在重叠，因此何时检测何种设计问题就需要进行折衷考虑。DRC通常在设计完成之后及pcbfwd运行之前才能正确地运行。理想情况下，运行pcbfwd只为了封装设计，因此更多的DRC可以得到更好的检测结果。但设计人员仍然需要在其投入精力开发具有超强功能的DRC与pcbfwd现有的免费功能之间取得平衡。这一节简单地讨论了这些问题。
pcbfwd由配置文件控制，如果布线工具为Allegro，那么配置文件名为all电感器生产厂家egro.cfg。配置文件中的BeginChkRules - EndChkRules部分可用来检测众多错误，如相同符号的重复属性、非法网路和网路属性名称、损坏的异质封装、异质符号上的冲突属性及遗漏属性。例如，为了在异质符号上获取冲突的属性，可以在allegro.cfg文件中添加如下内容：
CHKBRD _HETERO_ATT ERR 0
但仍有一些问题既不能采用DRC，也不能采用pcbfwd进行检测，如PCB设计中的预期冗余。假定器件包含4个完全相同的部分，其中两个部分用于设计，那么这些部分既可以封装在相同器件中，也可以出于冗余考虑将其封装在两个器件中。如果只需要一个器件，那么两部分用到的符号将具有相同的参考标志符(如U4)；如果需要两个器件，那么符号将具有不同的参考标志符(如U4和U5)，设计人员必须有意识地加以标注。目前尚无检测这类问题的便捷方法，因此只有通过严共模电感器谨的设计进行保障。
此电感器批发外，尽管DRC和/或pcbfwd可以检测符号是否具有所需的几何属性GEOM，但并不能检测其值是否与电路图符号相匹配。例如，ViewDraw符号指定的引脚数目就有可能与Allegro电感器生产覆盖区的引脚数目不匹配。
这类特殊错误可由Allegro的dev_check进行检测。首先，在ViewDraw电路图上运行pcbfwd工具，创建Allegro设备文件，该文电感器生产厂家件连同Allegro覆盖区文件将导入至dev_check。假定引脚68、69和70位于Allegro覆盖区而不在ViewDraw上，那么dev_check就能检测到该错误。这些引脚可以是不相连引脚，安装孔引脚，甚至是由于失误而仍留在ViewDraw 符号外的POWER/GROUND引脚。不相连引脚和/或安装孔引脚必须赋以NC属性，而POWER/GROUND引脚则必须赋以SIGNAL属性。按这种方式修正符号，然后重新运行pcbfwd 和dev_check。
绕行电
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