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基于FPGA的数字视频转换接口的设计与实现

时间:2015-08-04  来源:扁平线圈电感厂家  点击:

图3 软件功能框图

图3中FPGA内部的工作时钟有两个,以图中的虚线为界,虚线左侧部分使用的时钟为图像传感器的54MHz像素时钟;虚线右侧使用的时钟是经过锁相环将晶振的50MHz时钟倍频成108MHz以后的时钟,其中108MHz的时钟是由输出图像的分辨率所决定的。两个时钟域通过异步FIFO相连。整个系统共分成6个模块:解交织模块、YCbCr转RGB模块、异步FIFO模块、乒乓操作模块、SDRAM控制器模块和VGA发送模块。此外,系统还可实现图像静止、系统待机、模式选择等功能。


  图像显示效果

  图4是输出图像分辨率为1280×960模式下的显示效果,图中显示器检测到的视频图像分辨率为1280×960

图4 1280×960模式下的显示效果




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