漏电流求救

测试模块的漏电流，输入为三相电，拓扑为维也纳＋全桥LLC，在地线串进一个万用表测试模块的漏电流，待机漏电流为4.2mA，带载就变大为20多了。

想请教下为什么带载条件下漏电流会变大？还有怎么减小漏电流？ 微信图片_20200518153244.jpg(168 KB, 下载次数: 2)下载附件2020-5-18 15:31 上传因为EMC，先解决EMC
为什么加载后会变差呢？主要是Y电容的影响吗？但是更改各种值，没有什么改善啊
因为加载后EMC更厉害
想不出来漏电流为什么会和EMC有关系，按您意思还是EMC越差漏电流越大的正比关系的？
应该是带载后工作频率升高引起的
Y电容上的工频电流和高频电流的关系
由EMC引起的话，外界环境会有影响吗？

大电流电感

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